HBM4的推出，逻辑芯片的制造工艺已采纳5纳米或更小的先进工艺，缩短了PNM工夫的实施门槛。

跟着HBM4行将量产，存储器半导体行业正全力参加下一代工夫“HBM-PNM”的探究。此举备受存眷，被视为为以“可策画存储器”为中心的新时期作念准备，该时期胜利在存储器里面贬责策画，突破了以显卡(GPU)为中心的架构的纵容。

据业内东说念主士11日露馅，由三星电子、英伟达、加州大学圣地亚哥分校、哥伦比亚大学和延世大学构成的聚会探究团队最近在arXiv上发表了一篇对于AMMA（多芯片内存中心架构）工夫的论文，展示了HBM-PNM工夫的可行性。

PNM（近内存贬责）工夫通过将异常的策画单位放手在HBM堆栈的逻辑芯片上，胜利在内存独揽引申策画。现存的PIM（内存内贬责）措施将策画电路放手在存储单位里面，而PNM的上风在于简略在保握内存容量的同期，已矣更复杂、更高大的策画。

现在，大型话语模子（LLM）就业的最大瓶颈在于解码阶段的注眼力机制。在对长高下文进行解码注眼力时，GPU向上95%的策画智商处于闲置情景，导致内存带宽竟然被皆备专揽。

即使是Rubin GPU，分析也自满，其策画中枢（占封装面积的67%，功耗的73%）在永劫期运转的情况下本色专揽率仅为4%至5%傍边。这形成了资源花费，亦然导致功耗增多和发烧问题的主要原因。

跟着HBM4的推出，逻辑芯片的制造工艺已采纳5纳米或更小的先进工艺，缩短了PNM工夫的实施门槛。该探究团队建议的AMMA决策移除了现存GPU的策画芯片，并将16个HBM-PNM立方体以4×4网格结构邻接起来。这使得封装内的内存带宽进步至44TB/s，约为现存架构的两倍。

在本色探究中，与NVIDIA H100比拟，AMMA架构将注眼力蔓延缩短了15.5倍，能耗缩短了6.9倍。其速率也比下一代Rubin GPU快1.8到2.5倍，能效提高了2.6到3.1倍。尤其值得一提的是，它在贬责百万级（1M Context）的超长高下文推理和智能体责任负载方面进展出色。

探究团队暗示：“通过这项探究，咱们旨在确认以内存为中心的架构有后劲成为GPU以外的新式架构，并促进对下一代系统的探究，在这些系统中，Z6尊龙凯时官方网站以内存为中心的加快器在异构平台中阐述着要津作用。”

在摩尔定律的发展的几十年里，贬责器、存储器等组件逼迫发展，贬责器算力、存储器存储量都得到了大幅进步。但与之而来的，即是“存储墙”、“带宽墙”、“功耗墙”等问题。由于贬责器的峰值算力每两年增长3.1倍，而动态存储器的带宽每两年增长1.4倍，存储器的发展速率远过期于贬责器，收支1.7倍。CPU时钟速率与片外内存和磁盘驱动器I/O速率之间的差距越来越大。比如，动态立时存储器DRAM（Dynamic Random Access Memory）是芯片范畴“最大量单一居品”，精密工业制造的王冠之一，被喻为邻接中央贬责器（CPU）的“数据高速公路”。其功能是暂存正在运转的多样要领和数据，是一种易失性存储器，即断电后数据就丢失。DRAM由于其较差的可彭胀性和极高的设想资本敏锐性（每比特资本），其发展相对较慢，在10nm工夫节点就际遇了天花板。

存储墙导致访存时延高，效果低，存储器的数据窥察速率跟不上贬责器的数据贬责速率，存算性能失配。为了冲破存储墙，一经建议了多半的探究责任来优化DRAM架构，上文提到的近存策画即是一种，此外还有存内策画等路线。

存内策画是在内存中完成部分策画，在贬责器中完成部分策画。相较于内存策画将策画所需的所稀奇据放入到内存中，统统策画由贬责器完成，存内策画缩短了数据在内存与高速缓存，高速缓存与CPU之间出动的能耗，提高内存策画系统的性能。其中枢上风在于高算力、低功耗、低蔓延，主要分为端侧（小算力低功耗）、边侧（中算力及时贬责）和云侧（高算力）。典型应用范畴包括：末端及物联网(IoT)场景、角落策画及AI想到场景以及云霄/大限制策画场景。

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